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    Estimation methods for static noise margins in CMOS subthreshold logic circuits
    Bortolon, Felipe T. ; Moreira, Matheus T ; et al.
    In: 2017 30th Symposium on Integrated Circuits and Systems Design (SBCCI), 2017-08-01, S. 90-95
    Online Konferenz
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    Design of a low power 10-bit 12MS/s asynchronous SAR ADC in 65nm CMOS
    Campos, Arthur Lombardi ; Navarro, Joao ; et al.
    In: 2019 32nd Symposium on Integrated Circuits and Systems Design (SBCCI), 2019-08-01, S. 1-6
    Online Konferenz
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    Performance Enhancement of CMOS VLSI Circuits by Transistor Reordering
    Carlson, B.S. ; Chen, C.Y.R.
    In: 30th ACM/IEEE Design Automation Conference, 1993, S. 361-366
    Online Konferenz
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    Bridge Fault Simulation Strategies for CMOS Integrated Circuits
    Chess, B. ; Larrabee, T.
    In: 30th ACM/IEEE Design Automation Conference, 1993, S. 458-462
    Online Konferenz
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    A Rule-Based Circuit Representation for Automated CMOS Design and Verification
    Wu, C.-F.E. ; Wojcik, A.S. ; et al.
    In: 24th ACM/IEEE Design Automation Conference, 1987, S. 786-792
    Online Konferenz
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    Test Pattern Generation for Stuck-Open Faults Using Stuck-At Test Sets in CMOS Combinational Circuits
    Hyung Ki Lee ; Dong Sam Ha ; et al.
    In: 26th ACM/IEEE Design Automation Conference, 1989, S. 345-350
    Online Konferenz
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    Security primitive design with nanoscale devices: A case study with resistive RAM
    Karam, Robert ; Liu, Rui ; et al.
    In: 2016 International Great Lakes Symposium on VLSI (GLSVLSI), 2016-05-01, S. 299-304
    Online Konferenz
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    Electrical Debugging of Synchronous MOS VLSI Circuits Exploiting Analysis of the Intended Logic Behaviour
    Bolsens, I. ; De Rammelaer, W. ; et al.
    In: 26th ACM/IEEE Design Automation Conference, 1989, S. 513-518
    Online Konferenz
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    Variability-Tolerant Memristor-based Ratioed Logic in Crossbar Array
    Escudero, M. ; Vourkas, I. ; et al.
    In: 2018 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2018-07-01, S. 1-6
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    Integrated Synthesis Methodology for Crossbar Arrays
    Morgul, M. Ceylan ; Tunali, Onur ; et al.
    In: 2018 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2018-07-01, S. 1-7
    Online Konferenz
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    A sampling clock skew correction technique for time-interleaved SAR ADCs
    Prashanth, Daniel ; Lee, Hae-Seung
    In: 2016 International Great Lakes Symposium on VLSI (GLSVLSI), 2016-05-01, S. 129-132
    Online Konferenz
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    8T1R: A novel low-power high-speed RRAM-based non-volatile SRAM design
    Tosson, Amr M. S. ; Neale, Adam ; et al.
    In: 2016 International Great Lakes Symposium on VLSI (GLSVLSI), 2016-05-01, S. 239-244
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    An on-chip autonomous thermoelectric energy management system for energy-efficient active cooling
    Alexandrov, Borislav ; Ahmed, Khondker Z. ; et al.
    In: 2014 IEEE/ACM International Symposium on Low Power Electronics and Design (ISLPED), 2014-08-01, S. 51-56
    Konferenz
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    Statistical Estimation of the Switching Activity in Digital Circuitsy
    Xakellis, M.G. ; Najm, F.N.
    In: 31st Design Automation Conference, 1994, S. 728-733
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    On Accuracy of Switch-Level Modeling of Bridging Faults in Complex Gates
    Rajsuman, R. ; Jayasumana, A.P. ; et al.
    In: 24th ACM/IEEE Design Automation Conference, 1987, S. 244-250
    Online Konferenz
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