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    Multistage Linear Feedback Shift Register Counters With Reduced Decoding Logic in 130-nm CMOS for Large-Scale Array Applications
    Morrison, Daniel ; Delic, Dennis ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019), S. 103-115
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    Design of a CMOS System-on-Chip for Passive, Near-Field Ultrasonic Energy Harvesting and Back-Telemetry
    Lajnef, Nizar ; Chakrabartty, Shantanu ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-02-01), S. 544-554
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    An Energy-Efficient All-Digital Time-Domain-Based CMOS Temperature Sensor for SoC Thermal Management
    Jung, Dong-Hoon ; An, Young-Jae ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-08-01), S. 1508-1517
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    A 28-nm CMOS 1 V 3.5 GS/s 6-bit DAC with signal-independent delta-I noise DfT scheme
    Quinn, Patrick J. ; Radulov, Georgi ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015), Heft 1, S. 44-53
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    Large Delay Analog Trojans: A Silent Fabrication-Time Attack Exploiting Analog Modalities
    Yang, Tiancheng ; Shrivastava, Aatmesh ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021), S. 124-135
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    Design of Defect and Fault-Tolerant Nonvolatile Spintronic Flip-Flops
    Tahoori, Mehdi B. ; Bishnoi, Rajendra ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 25 (2017-04-01), S. 1421-1432
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    HAVA: Heterogeneous Multicore ASIP for Multichannel Low-Bit-Rate Vocoder Applications
    Liu, Peilin ; Wei, Zhenqi ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-07-01), S. 2593-2597
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    Low-Energy Power-ON-Reset Circuit for Dual Supply SRAM
    Yagnesh Dineshbhai Vaderiya ; Chhabra, Amit
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), S. 2003-2007
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    Soft-Core Embedded-FPGA Based on Multistage Switching Networks: A Quantitative Analysis
    Mucci, Claudio ; Eleonora Franchi Scarselli ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-12-01), S. 3043-3052
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    Optimal Positions of Twists in Global On-Chip Differential Interconnects
    E. van Tuijl ; Mensink, E. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 15 (2007-04-01), S. 438-446
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    Asymmetric Aging: Introduction and Solution for Power-Managed Mixed-Signal SoCs
    Jain, Palkesh ; Cano, Frank ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 22 (2014-03-01), S. 691-695
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    Implementing Minimum-Energy-Point Systems With Adaptive Logic
    Koskinen, Lauri ; Hiienkari, Markus ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016), Heft 4, S. 1247-1256
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    An On-Chip Network Fabric Supporting Coarse-Grained Processor Array
    Kim, Chulwoo ; Kim, Jungmoon ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013), S. 178-182
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    Reduction of Coupling Effects by Optimizing the 3-D Configuration of the Routing Grid
    Matsushita, Yoshifumi ; Yamada, T. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 11 (2003-10-01), Heft 5, S. 951-954
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    Linear and Switch-Mode Conversion in 3-D Circuits
    Rosenfeld, Jonathan ; Friedman, Eby G.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 19 (2011-11-01), S. 2095-2108
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    Yield Enhancement by Bad-Die Recycling and Stacking With Though-Silicon Vias
    Wu, Cheng-Wen ; Kwai, Ding-Ming ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 19 (2011-08-01), S. 1346-1356
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    Reducing SRAM Power Using Fine-Grained Wordline Pulsewidth Control
    Mohamed Hassan Abu-Rahma ; Sei Seung Yoon ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 18 (2010-03-01), S. 356-364
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    FleXilicon Architecture and Its VLSI Implementation
    Dong Sam Ha ; Lee, Jong-Suk
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-08-01), S. 1021-1033
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    Quasi-Resonant Interconnects: A Low Power, Low Latency Design Methodology
    Rosenfeld, Jonathan ; Friedman, Eby G.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 17 (2009-02-01), S. 181-193
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    An On-Chip Multichannel Waveform Monitor for Diagnosis of Systems-on-a-Chip Integration
    Noguchi, K. ; Nagata, Makoto
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 15 (2007-10-01), S. 1101-1110
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