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    A 2.8 GS/s 44.6 mW Time-Interleaved ADC Achieving 50.9 dB SNDR and 3 dB Effective Resolution Bandwidth of 1.5 GHz in 65 nm CMOS
    Stepanovic, D. ; Nikolic, B.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-04-01), Heft 4, S. 971-982
    Online academicJournal
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    A 16-Gb/s Backplane Transceiver With 12-Tap Current Integrating DFE and Dynamic Adaptation of Voltage Offset and Timing Drifts in 45-nm SOI CMOS Technology
    Gangasani, G. R. ; Hsu, C. H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 47 (2012-08-01), Heft 8, S. 1828-1841
    Online academicJournal
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    A 224-Gb/s DAC-Based PAM-4 Quarter-Rate Transmitter With 8-Tap FFE in 10-nm FinFET
    Kim, J. ; Kundu, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022), Heft 1, S. 6-20
    Online academicJournal
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    A 10-bit 250-MS/s binary-weighted current-steering DAC
    Deveugele, J. ; Steyaert, M.S.J.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006-02-01), Heft 2, S. 320-329
    Online academicJournal
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    A Reconfigurable 1 GSps to 250 MSps, 7-bit to 9-bit Highly Time-Interleaved Counter ADC with Low Power Comparator Design
    Danesh, S. ; Hurwitz, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-03-01), Heft 3, S. 733-748
    Online academicJournal
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    A low-power 128-MHz VCO for monolithic PLL ICs
    Kato, K. ; Sase, T. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 23 (1988-04-01), Heft 2, S. 474-479
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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sm 576 - 768
md 768 - 992
lg 992 - 1200
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