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    A 16-Mb 400-MHz loadless CMOS four-transistor SRAM macro
    Takeda, K. ; Aimoto, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 35 (2000-11-01), Heft 11, S. 1631-1640
    Online academicJournal
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    A CMOS analog timing recovery circuit for PRML detectors
    Roo, P. ; Spencer, R.R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 35 (2000), Heft 1, S. 56-65
    Online academicJournal
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    An 833-MHz 1.5-W 18-Mb CMOS SRAM with 1.67 Gb/s/pin
    Pilo, H. ; Allen, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 35 (2000-11-01), Heft 11, S. 1641-1647
    Online academicJournal
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    Volltext
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    A portable clock multiplier generator using digital CMOS standard cells
    Combes, M. ; Dioury, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 31 (1996-07-01), Heft 7, S. 958-965
    Online academicJournal
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    An integrated high resolution CMOS timing generator based on an array of delay locked loops
    Christiansen, J.
    In: IEEE Journal of Solid-State Circuits, Jg. 31 (1996-07-01), Heft 7, S. 952-957
    Online academicJournal
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    A 700-MHz 24-b pipelined accumulator in 1.2- mu m CMOS for application as a numerically controlled oscillator
    Lu, F. ; Samueli, H. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 28 (1993-08-01), Heft 8, S. 878-886
    Online academicJournal
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    A 17-ns 4-Mb CMOS DRAM
    Nagai, T. ; Numata, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 26 (1991-11-01), Heft 11, S. 1538-1543
    Online academicJournal
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    A 9-ns 16-Mb CMOS SRAM with offset-compensated current sense amplifier
    Seno, K. ; Knorpp, K. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 28 (1993-11-01), Heft 11, S. 1119-1124
    Online academicJournal
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    A CMOS continuous-time NTSC-to-color-difference decoder
    Parker, J.F. ; Current, K.W. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 30 (1995-12-01), Heft 12, S. 1524-1532
    Online academicJournal
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    A CMOS RISC CPU designed for sustained high performance on large applications
    Lotz, J. ; Miller, B. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 25 (1990-10-01), Heft 5, S. 1190-1198
    Online academicJournal
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    Elimination of process-dependent clock skew in CMOS VLSI
    Shoji, M.
    In: IEEE Journal of Solid-State Circuits, Jg. 21 (1986-10-01), Heft 5, S. 875-880
    Online academicJournal
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    An 11-ns 8K*18 CMOS static RAM with 0.5- mu m devices
    Wong, D.T. ; Adams, R.D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 23 (1988-10-01), Heft 5, S. 1095-1103
    Online academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    A fully programmable sampled-data analog CMOS filter with transfer-function coefficients determined by timing
    Vallancourt, D. ; Tsividis, Y.P.
    In: IEEE Journal of Solid-State Circuits, Jg. 22 (1987-12-01), Heft 6, S. 1022-1030
    Online academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    A 1.5 V CMOS 4-bit microcomputer needs only 100 /spl mu/W
    Meusburger, G. ; Jones, R.C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 18 (1983-06-01), Heft 3, S. 245-249
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    An Integrated Power Supply System for Low Power 3.3 V Electronics Using On-Chip Polymer Electrolyte Membrane (PEM) Fuel Cells
    Frank, M. ; Kuhl, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010), Heft 1, S. 205-213
    Online academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    A sub-10-ps multiphase sampling system using redundancy
    Lee, Li-min ; Weinlader, D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 41 (2006), Heft 1, S. 265-273
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  17. Detailansicht für Treffer 17 öffnen
    A 100/spl times/100 pixel silicon retina for gradient extraction with steering filter capabilities and temporal output coding
    Barbaro, M. ; Burgi, P. Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 37 (2002-02-01), Heft 2, S. 160-172
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    A low-power direct digital synthesizer using a self-adjusting phase-interpolation technique
    Nosaka, H. ; Yamaguchi, Y. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 36 (2001-08-01), Heft 8, S. 1281-1285
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    A comprehensive CAD system for high-performance 300 K-circuit ASIC logic chips
    Panner, J.H. ; Abato, R.P. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 26 (1991-03-01), Heft 3, S. 300-309
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    A 1.6 GB/s DDR2 128 Mb Chain FeRAM With Scalable Octal Bitline and Sensing Schemes
    Shiga, H. ; Takashima, D. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 45 (2010), Heft 1, S. 142-152
    Online academicJournal
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