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    Development of a Low Standby Power Six-Transistor CMOS SRAM Employing a Single Power Supply
    Enomoto, Tadayoshi ; Kobayashi, Nobuaki
    In: IEICE Transactions on Electronics, 2018-10-01, S. 822-830
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    Pseudo-CMOS with Re-Pull-Down Transistor: A Low Power Inverter Design for Thin-Film Transistors
    Yao, Ruohe ; Zhong, Lihao ; et al.
    In: IEICE Transactions on Electronics, 2016, S. 727-729
    Online unknown
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    CMOS Circuits Based on a Stacked Structure Using Silicone-Resin as Dielectric Layers
    Pu, Fanghua ; Kudo, Kazuhiro ; et al.
    In: IEICE Transactions on Electronics, 2011, S. 136-140
    Online unknown
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    A 580fs-Resolution Time-to-Digital Converter Utilizing Differential Pulse-Shrinking Buffer Ring in 0.18µm CMOS Technology
    Iizuka, Tetsuya ; Miura, Satoshi ; et al.
    In: IEICE Transactions on Electronics, 2012, S. 661-667
    Online unknown
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    A Large 'Read' and 'Write' Margins, Low Leakage Power, Six-Transistor 90-nm CMOS SRAM
    Kobayashi, Nobuaki ; Enomoto, Tadayoshi
    In: IEICE Transactions on Electronics, 2011, S. 530-538
    Online unknown
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    CMOS Cascode Source-Drain Follower for Monolithically Integrated Biosensor Array
    Nakazato, Kazuo ; Ohura, Mitsuo ; et al.
    In: IEICE Transactions on Electronics, 2008-09-01, S. 1505-1515
    Online unknown
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    Characterization of Zinc Oxide and Pentacene Thin Film Transistors for CMOS Inverters
    Yamauchi, Hiroshi ; Watanabe, Yasuyuki ; et al.
    In: IEICE Transactions on Electronics, 2008-12-01, S. 1843-1847
    Online unknown
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    Design and Performance of a Sub-Nano-Ampere Two-Stage Power Management Circuit in 0.35-.MU.m CMOS for Dust-Size Sensor Nodes
    Harada, Mitsuru ; Ugajin, Mamoru ; et al.
    In: IEICE Transactions on Electronics, 2011, S. 1206-1211
    Online unknown
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    A High Performance CMOS Direct Down Conversion Mixer for UWB System
    Yun A Shim ; Lee, Sang-Gug ; et al.
    In: IEICE Transactions on Electronics, 2005-12-01, S. 2316-2321
    Online unknown
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  10. Detailansicht für Treffer 10 öffnen
    A One-Step Input Matching Method for Cascode CMOS Low-Noise Amplifiers
    Ming Chang Sun ; Ying Haw Shu ; et al.
    In: IEICE Transactions on Electronics, 2005-03-01, S. 420-428
    Online unknown
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    A De-Embedding Method Using Different-Length Transmission Lines for mm-Wave CMOS Device Modeling
    Takayama, Naoki ; Li, Ning ; et al.
    In: IEICE Transactions on Electronics, 2010-06-01, Heft No. 6, S. 812-819
    Online unknown
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    360- W/1 mW Complementary Cross-Coupled Differential Colpitts LC-VCO/QVCO in 0.25- m CMOS
    Lee, Sang-Gug ; Yun, Seok-Ju ; et al.
    In: IEICE Transactions on Electronics, 2007-12-01, S. 2289-2292
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    A Highly Linear CMOS Transconductor
    Roger Yubtzuan Chen ; Lin, Sheng-Feng
    In: IEICE Transactions on Electronics, 2006-10-01, S. 1480-1484
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    A 13.56 MHz CMOS RF Identification Passive Tag LSI with Ferroelectric Random Access Memory
    Teramoto, Toshiyuki ; Masui, Shoichi
    In: IEICE Transactions on Electronics, 2005-04-01, S. 601-607
    Online unknown
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  15. Detailansicht für Treffer 15 öffnen
    A CMOS SRAM Test Cell Design Using Selectively Metal-Covered Transistors for a Laser Irradiation Failure Analysis
    Hatano, Hiroshi
    In: IEICE Transactions on Electronics, 2012, S. 1827-1829
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  16. Detailansicht für Treffer 16 öffnen
    High Transport Si/SiGe Heterostructures for CMOS Transistors with Orientation and Strain Enhanced Mobility
    Huang, Jeff ; Hi Deok Lee ; et al.
    In: IEICE Transactions on Electronics, 2011, S. 712-716
    Online unknown
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  17. Detailansicht für Treffer 17 öffnen
    Operation of Ultra-Low Leakage Regulator Circuits with SOI and Bulk Technologies for Controlling Wireless Transceivers
    Ugajin, Mamoru ; Harada, Mitsuru ; et al.
    In: IEICE Transactions on Electronics, 2011, S. 1702-1705
    Online unknown
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  18. Detailansicht für Treffer 18 öffnen
    Design of Asynchronous Multi-Bit OTP Memory
    Choi, Chul-Ho ; Ahn, Kwang-Seon ; et al.
    In: IEICE Transactions on Electronics, 2009, S. 173-177
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  19. Detailansicht für Treffer 19 öffnen
    An Outside-Rail Opamp Design Relaxing Low-Voltage Constraint on Future Scaled Transistors
    Ishikuro, Hiroki ; Takamiya, Makoto ; et al.
    In: IEICE Transactions on Electronics, 2007-04-01, S. 786-792
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  20. Detailansicht für Treffer 20 öffnen
    A Differential Cell Terminal Biasing Scheme Enabling a Stable Write Operation against a Large Random Threshold Voltage (Vth) Variation
    Yamauchi, Hiroyuki ; Suzuki, Toshikazu ; et al.
    In: IEICE Transactions on Electronics, 2006-11-01, S. 1526-1534
    Online unknown
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