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    Design of Full Adder Circuits with Optimized Power and Speed Using CMOS Technique
    Rajput, Vishal ; Singh, Abhay Pratap ; et al.
    In: 2024 IEEE International Students' Conference on Electrical, Electronics and Computer Science (SCEECS), 2024-02-24, S. 1-5
    Konferenz
    Wie komme ich dran?
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    Optimization of Leakage Power Dissipation in CMOS Inverter using Self biased and W/L Scaling Techniques
    Prakash, Amiya ; Jain, Priyanaka
    In: 2023 2nd International Conference on Futuristic Technologies (INCOFT), 2023-11-24, S. 1-5
    Konferenz
    Wie komme ich dran?
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    Design and Performance Analysis of 6T SRAM Cell on Different CMOS Technologies
    Parveen, Sd Nageena ; Charishma, V ; et al.
    In: 2023 World Conference on Communication & Computing (WCONF), 2023-07-14, S. 1-4
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    Aging Analysis of CMOS Based Synaptic Circuits
    Negi, Krishna ; Babu, Jani ; et al.
    In: 2024 8th IEEE Electron Devices Technology & Manufacturing Conference (EDTM), 2024-03-03, S. 1-3
    Konferenz
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    Nanoscale CMOS Biasing Circuit for Analog Applications: The Impact of NBTI Degradation
    Vijay, Ashish ; Duari, Chusen ; et al.
    In: 2023 International Conference for Advancement in Technology (ICONAT), 2023-01-24, S. 1-3
    Konferenz
    Wie komme ich dran?
  6. Detailansicht für Treffer 6 öffnen
    6T SRAM Cell Design Using CMOS at Different Technology nodes
    Mittal, Deepak
    In: 2022 IEEE 3rd Global Conference for Advancement in Technology (GCAT), 2022-10-07, S. 1-5
    Konferenz
    Wie komme ich dran?
  7. Detailansicht für Treffer 7 öffnen
    Performance Analysis of 1-Bit Full Adder CMOS Using Bridge Style Logic
    Singh, Alok Kumar ; Meher, Preetisudha
    In: 2022 IEEE 7th International conference for Convergence in Technology (I2CT), 2022-04-07, S. 1-5
    Konferenz
    Wie komme ich dran?
  8. Detailansicht für Treffer 8 öffnen
    Analysis of Static Power Reduction Strategies in Deep Submicron CMOS Device Technology for Digital Circuits
    Munirathnam, G. ; Babu, Y. Murali Mohan
    In: 2021 6th International Conference on Signal Processing, Computing and Control (ISPCC), 2021-10-07, S. 278-282
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    CMOS Based Ultra Low Power GRN Circuit Design for Bacterial Cell
    Acharya, Moumita ; Chakrabarti, Amlan ; et al.
    In: 2023 8th International Conference on Computers and Devices for Communication (CODEC), 2023-12-14, S. 1-2
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Optimization of Hybrid CMOS Designs Using a New Energy Efficient 1 Bit Hybrid Full Adder
    Lakshmi, S ; Meenu Raj, C ; et al.
    In: 2018 3rd International Conference on Communication and Electronics Systems (ICCES), 2018-10-01, S. 905-908
    Konferenz
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Static and Dynamic power optimization using Leakage Feedback approach for nanoscale CMOS VLSI circuits
    Mallaraddi, Vidyavati ; Rajani, H P ; et al.
    In: 2022 First International Conference on Electrical, Electronics, Information and Communication Technologies (ICEEICT), 2022-02-16, S. 1-5
    Konferenz
    Wie komme ich dran?
  12. Detailansicht für Treffer 12 öffnen
    VLSI Implementation of 8-PSK/8-QAM/16-QAM Transmitter Circuit in CMOS Technology
    Bozomitu, Radu Gabriel ; Cracan, Arcadie ; et al.
    In: 2020 43rd International Spring Seminar on Electronics Technology (ISSE), 2020-05-01, S. 1-6
    Konferenz
    Wie komme ich dran?
  13. Detailansicht für Treffer 13 öffnen
    An Energy-Efficient Time-Domain Analog CMOS BinaryConnect Neural Network Processor Based on a Pulse-Width Modulation Approach
    Yamaguchi, M. ; Iwamoto, G. ; et al.
    In: IEEE Access, Jg. 9 (2021), S. 2644-2654
    Online academicJournal
    Zugriff:
    Volltext
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  14. Detailansicht für Treffer 14 öffnen
    On ultra-low power hybrid NEMS-CMOS
    Beiu, V. ; Ibrahim, W. ; et al.
    In: 14th IEEE International Conference on Nanotechnology, 2014-08-01, S. 201-206
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    Design and Implementation of 8-Bit Vedic Multiplier Using CMOS Logic
    Deodhe, Yeshwant ; Kakde, Sandeep ; et al.
    In: 2013 International Conference on Machine Intelligence and Research Advancement, 2013-12-01, S. 340-344
    Konferenz
    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    Mixed FBB and RBB low leakage technique for high durable CMOS circuit
    Barua, Parag ; Jafar, Imran Bin ; et al.
    In: 2014 International Conference on Informatics, Electronics & Vision (ICIEV), 2014-05-01, S. 1-5
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    Ultra-Low Energy Consumed GDI Based Hamming Code High Speed Signal Processing Communication System for IOT Application
    Mythry, Sarin Vijay ; Adupa, Chakradhar ; et al.
    In: 2024 International Conference on Emerging Smart Computing and Informatics (ESCI), 2024-03-05, S. 1-6
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Input Vector Control efficiency in sub-micron CMOS technologies
    Shurin, Dmitry ; Kvaktun, Evgeniy ; et al.
    In: 2010 IEEE 26-th Convention of Electrical and Electronics Engineers in Israel, 2010-11-01, S. 569-573
    Konferenz
    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    Computer-Aided Design for Low-Power Robust Computing in Nanoscale CMOS
    Sylvester, D. ; Srivastava, A.
    In: Proceedings of the IEEE, Proc. IEEE, Jg. 95 (2007-03-01), Heft 3, S. 507-529
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    Turning silicon on its edge [double gate CMOS/FinFET technology]
    Nowak, E.J. ; Aller, I. ; et al.
    In: IEEE Circuits and Devices Magazine, Jg. 20 (2004), Heft 1, S. 20-31
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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