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52 Treffer

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    A Low-Power Convolutional Neural Network Implemented in 40-nm CMOS Technology for Bearing Fault Diagnosis
    Liang, Yu-Pei ; Chang, Hui-Hsuan ; et al.
    In: 2024 International VLSI Symposium on Technology, Systems and Applications (VLSI TSA), 2024-04-22, S. 1-4
    Konferenz
    Wie komme ich dran?
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    The Power Dissipation of Complementary Metal Oxide Semiconductor (CMOS) Inverter and Propagation Delay for Various Technologies
    Verma, Archana ; Singh, Vimalendra ; et al.
    In: 2023 International Conference on Sustainable Emerging Innovations in Engineering and Technology (ICSEIET), 2023-09-14, S. 25-30
    Konferenz
    Wie komme ich dran?
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    Nanoscale CMOS Biasing Circuit for Analog Applications: The Impact of NBTI Degradation
    Vijay, Ashish ; Duari, Chusen ; et al.
    In: 2023 International Conference for Advancement in Technology (ICONAT), 2023-01-24, S. 1-3
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    6T SRAM Cell Design Using CMOS at Different Technology nodes
    Mittal, Deepak
    In: 2022 IEEE 3rd Global Conference for Advancement in Technology (GCAT), 2022-10-07, S. 1-5
    Konferenz
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    Performance Analysis of 1-Bit Full Adder CMOS Using Bridge Style Logic
    Singh, Alok Kumar ; Meher, Preetisudha
    In: 2022 IEEE 7th International conference for Convergence in Technology (I2CT), 2022-04-07, S. 1-5
    Konferenz
    Wie komme ich dran?
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    VLSI Implementation of a High Speed and Area efficient N-bit Digital CMOS Comparator
    Karunakaran, S. ; Pavan, K. ; et al.
    In: 2021 Second International Conference on Smart Technologies in Computing, Electrical and Electronics (ICSTCEE), 2021-12-16, S. 1-4
    Konferenz
    Wie komme ich dran?
  7. Detailansicht für Treffer 7 öffnen
    Performance Analysis of Full Adder Circuits Using Different Static CMOS Based Threshold Logic Gate
    Sarkar, Mili ; Taki, Gouranga Sundar
    In: 2021 Devices for Integrated Circuit (DevIC), 2021-05-19, S. 521-524
    Konferenz
    Wie komme ich dran?
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    Optimization of Hybrid CMOS Designs Using a New Energy Efficient 1 Bit Hybrid Full Adder
    Lakshmi, S ; Meenu Raj, C ; et al.
    In: 2018 3rd International Conference on Communication and Electronics Systems (ICCES), 2018-10-01, S. 905-908
    Konferenz
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    VLSI Implementation of 8-PSK/8-QAM/16-QAM Transmitter Circuit in CMOS Technology
    Bozomitu, Radu Gabriel ; Cracan, Arcadie ; et al.
    In: 2020 43rd International Spring Seminar on Electronics Technology (ISSE), 2020-05-01, S. 1-6
    Konferenz
    Wie komme ich dran?
  10. Detailansicht für Treffer 10 öffnen
    Design of Spin-FET Electrical Model for Basic Gates
    Rajput, Priti Jagatsing ; Bhandari, Sheetal U. ; et al.
    In: 2024 IEEE 4th International Conference on VLSI Systems, Architecture, Technology and Applications (VLSI SATA), 2024-05-17, S. 1-5
    Konferenz
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Power Modeling for CMOS Circuits by RBF Network
    Qiang, W. ; Cao, Y. ; et al.
    In: 2005 IEEE Conference on Electron Devices and Solid-State Circuits, 2005, S. 743-746
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    SPICE compact modeling of PD-SOI CMOS devices
    Kuo, J.B.
    In: Proceedings 2000 IEEE Hong Kong Electron Devices Meeting (Cat. No.00TH8503), 2000, S. 1-4
    Konferenz
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  13. Detailansicht für Treffer 13 öffnen
    CMOS circuits and nanodevices for spike based neural computing
    Morie, Takashi
    In: 2015 IEEE International Meeting for Future of Electron Devices, Kansai (IMFEDK), 2015-06-01, S. 112-113
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    CMOS/SOS technology and device modeling
    Mukhanov, V.E.
    In: Siberian Russian Student Workshops and Tutorials on Electron Devices and Materials (Cat. No.00EX416), 2000, S. 63-69
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    A scaling procedure for Domino CMOS logic
    Wurtz, L.
    In: Proceedings IEEE Southeastcon '92, 1992, S. 580-585
    Konferenz
    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    Interconnect capacitance, crosstalk, and signal delay for 0.35 /spl mu/m CMOS technology
    Cho, D.H. ; Eo, Y.S. ; et al.
    In: International Electron Devices Meeting. Technical Digest, 1996, S. 619-622
    Konferenz
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  17. Detailansicht für Treffer 17 öffnen
    Efficient Implementation of Decimal to BCD Encoder using Modified-GDI Technique
    Soni, Divya ; Mehta, Usha
    In: 2023 IEEE International Symposium on Smart Electronic Systems (iSES), 2023-12-18, S. 373-376
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Floating-body problems and benefits in fully depleted SOI CMOS VLSI circuits
    Fossum, J.G. ; Yeh, P. C. ; et al.
    In: International Electron Devices Meeting 1991 [Technical Digest], 1991, S. 325-328
    Konferenz
    Wie komme ich dran?
  19. Detailansicht für Treffer 19 öffnen
    A logic-level model for /spl alpha/-particle hits in CMOS circuits
    Cha, H. ; Patel, J.H.
    In: Proceedings of 1993 IEEE International Conference on Computer Design ICCD'93, 1993, S. 538-542
    Konferenz
    Wie komme ich dran?
  20. Detailansicht für Treffer 20 öffnen
    Analysis of a Low-Power Full Adder and Half Adder Using a New Adiabatic Logic
    Ganguly, Chamak ; Meem, Mazeda Zafor ; et al.
    In: 2023 26th International Conference on Computer and Information Technology (ICCIT), 2023-12-13, S. 1-5
    Konferenz
    Wie komme ich dran?
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