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    6.25 GHz, 1 mV input resolution auxiliary circuit assisted comparator in 65 nm CMOS process
    Nithin Kumar Y., B ; Bonizzoni, Edoardo ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-03-06), S. 340-346
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    Effects of asymmetric underlap spacers on nanoscale junctionless transistors and design of optimised CMOS amplifiers
    Roy, Debapriya ; Biswas, Abhijit
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-06-03), S. 510-518
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    Fully‐differential flipped‐source‐follower low‐pass analogue filter in CMOS 28 nm bulk
    Mangiagalli, L. ; Marcello De Matteis ; et al.
    In: IET Circuits, Devices & Systems, Jg. 12 (2018-10-29), S. 689-695
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    All‐digital delay line‐based time difference amplifier in 65 nm CMOS technology
    Saneei, Mohsen ; Razmdideh, Ramin
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-04-30), S. 421-427
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    0.5 V bulk ‐ driven CMOS fully differential current feedback operational amplifier
    Khateb, Fabian ; Kumngern, Montree ; et al.
    In: IET Circuits, Devices & Systems, Jg. 13 (2019-03-18), S. 314-320
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    Novel CMOS MO‐CFDITA based fully electronically controlled square/triangular wave generator with adjustable duty cycle
    Chaturvedi, Bhartendu ; Kumar, Atul
    In: IET Circuits, Devices & Systems, Jg. 12 (2018-10-16), S. 817-826
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    65 nm CMOS switching discontinuous‐conduction mode buck converter with 330 ns start‐up time for light‐load power‐cycled applications
    Taherzadeh-Sani, Mohammad ; Nabki, Frederic ; et al.
    In: IET Circuits, Devices & Systems, Jg. 11 (2017-01-17), S. 267-273
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    0.97 mW/Gb/s, 4 Gb/s CMOS clock and data recovery IC with dynamic voltage scaling
    Byun, Sangjin
    In: IET Circuits, Devices & Systems, Jg. 10 (2016-05-01), S. 220-228
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    Resilience and yield of flip‐flops in future CMOS technologies under process variations and aging
    Backs, Benedikt ; Schmitt-Landsiedel, Doris ; et al.
    In: IET Circuits, Devices & Systems, Jg. 8 (2014), S. 19-26
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    1.1‐V, 8‐bit, 12 MS/s asynchronous reference‐free successive‐approximation‐register analogue‐to‐digital converter in 0.18 μm CMOS with separated capacitor arrays
    Huang, Guanzhong ; Lin, Pingfen
    In: IET Circuits, Devices & Systems, Jg. 7 (2013), S. 1-8
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    A 0.38 V near/sub‐ V T digitally controlled low‐dropout regulator with enhanced power supply noise rejection in 90 nm CMOS process
    Kim, Yongtae ; Li, Peng
    In: IET Circuits, Devices & Systems, Jg. 7 (2013), S. 31-41
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  12. Detailansicht für Treffer 12 öffnen
    Low power design of CMOS 5-GHz voltage-controlled oscillator from narrowband to wideband with switching capacitor module
    Hsu, Meng-Ting ; Chen, Shiao-Hui ; et al.
    In: IET Circuits, Devices & Systems, Jg. 3 (2009-06-01), S. 99-105
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    Volltext (PDF)
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  13. Detailansicht für Treffer 13 öffnen
    Subthreshold CMOS voltage reference circuit with body bias compensation for process variation
    Liang, Guo ; Zhu, Dazhong ; et al.
    In: IET Circuits, Devices & Systems, Jg. 6 (2012), S. 198-198
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    Switched positive/negative charge pump design using standard CMOS transistors
    Al-Bakheet, M.B. ; Mohammad, M.Gh. ; et al.
    In: IET Circuits, Devices & Systems, Jg. 4 (2010), S. 57-57
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  15. Detailansicht für Treffer 15 öffnen
    Approach for low power high speed 4‐bit flash analogue to digital converter
    Setoudeh, Farbod ; Mohammad Bagher Tavakoli ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-06-15), S. 425-431
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    Soft fault diagnosis of non‐linear circuits having multiple DC solutions
    Hałgas, Stanisław ; Tadeusiewicz, Michał
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-11-01), S. 1220-1227
    Online unknown
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    MPPT integrated DC–DC boost converter for RF energy harvester
    Parvin, Dilruba ; Hassan, Omiya ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-10-01), S. 1086-1091
    Online unknown
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    Variation resilient reliable design of trigger pulse generator
    Amit Krishna Dwivedi ; Kumar, Amresh ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-09-01), S. 860-868
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    Exploiting uncertain timing information in time‐based SAR ADCs
    Leitner, Stefan ; Abhilash Karnatakam Nagabhushana ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-03-09), S. 390-397
    Online unknown
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    Near threshold voltage digital PLL using low voltage optimised blocks for AR display system
    Kim, Chulwoo ; Lee, Sangsu ; et al.
    In: IET Circuits, Devices & Systems, Jg. 14 (2020-01-30), S. 155-158
    Online unknown
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