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    A Single-Controller-Four-Output Digital LDO With Priority-Time-Multiplexing Scheme and Clamping Loops in 65-nm CMOS
    Chen, F. ; Lu, Y. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 71 (2024-03-01), Heft 3, S. 1486-1490
    Online academicJournal
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    Automated In-Situ Monitoring for Variability-Resilient and Energy-Efficient Digital Circuits Demonstrated on a Viterbi Decoder in 22-nm CMOS
    Nieto Taladriz, C. ; Dehaene, W.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 31 (2023-09-01), Heft 9, S. 1320-1329
    Online academicJournal
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    A 2.0-to-7.4-GHz 16-Phase Delay-Locked Loop With a Sub-0.6-ps Phase-Delay Error in 40-nm CMOS
    Yang, J. ; Pan, Q. ; et al.
    In: IEEE Transactions on Microwave Theory and Techniques, Jg. 71 (2023-08-01), Heft 8, S. 3596-3604
    Online academicJournal
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    A 100-Gb/s PAM-4 Voltage-Mode Transmitter With High-Resolution Unsegmented Three-Tap FFE in 40-nm CMOS
    Chen, Y. ; Peng, P. ; et al.
    In: IEEE Solid-State Circuits Letters, Jg. 5 (2022), S. 218-221
    Online academicJournal
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    A Low-Ripple Charge Pump With Novel Compensator for Transient-Response Improvement in CMOS Image Sensors
    Gao, J. ; Gu, T. ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 68 (2021-04-01), Heft 4, S. 1113-1117
    Online academicJournal
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    Low Power Clock Generator Design With CMOS Signaling
    Fan, Y. ; Young, I.A.
    In: IEEE Open Journal of the Solid-State Circuits Society, Jg. 1 (2021), S. 162-170
    Online academicJournal
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    A Reconfigurable Switched Capacitor DC–DC Converter With 1.9–6.3-V Input Voltage Range and 85% Peak Efficiency in 28-nm CMOS
    Marin, G. ; Cherniak, K. ; et al.
    In: IEEE Solid-State Circuits Letters, Jg. 3 (2020), S. 106-109
    Online academicJournal
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    An NMOS Digital LDO With NAND-Based Analog-Assisted Loop in 28-nm CMOS
    Ma, X. ; Lu, Y. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 67 (2020-11-01), Heft 11, S. 4041-4052
    Online academicJournal
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    An All-Digital, $V_{\mathrm{MAX}}$ -Compliant, Stable, and Scalable Distributed Charge Injection Scheme in 10-nm CMOS for Fast and Local Mitigation of Voltage Droop
    Bang, S. ; Cho, M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-07-01), Heft 7, S. 1898-1908
    Online academicJournal
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    Computationally Enabled Minimum Total Energy Tracking for a Performance Regulated Sub-Threshold Microprocessor in 65-nm CMOS
    Rahman, F.u. ; Pamula, R. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 55 (2020-02-01), Heft 2, S. 494-504
    Online academicJournal
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    A 0.1–3.5-GHz Duty-Cycle Measurement and Correction Technique in 130-nm CMOS
    Raja, I. ; Banerjee, G. ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 24 (2016-05-01), Heft 5, S. 1975-1983
    Online academicJournal
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    Digital Assistant Power Integrated Technologies for PMU in Scaling CMOS Process
    Luo, P. ; Zhen, S. ; et al.
    In: IEEE Transactions on Power Electronics, Jg. 29 (2014-07-01), Heft 7, S. 3798-3807
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  13. Detailansicht für Treffer 13 öffnen
    A 0.5-V 1.6-mW 2.4-GHz Fractional-N All-Digital PLL for Bluetooth LE With PVT-Insensitive TDC Using Switched-Capacitor Doubler in 28-nm CMOS
    Pourmousavian, N. ; Kuo, F. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 53 (2018-09-01), Heft 9, S. 2572-2583
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  14. Detailansicht für Treffer 14 öffnen
    A 0.45–1 V Fully-Integrated Distributed Switched Capacitor DC-DC Converter With High Density MIM Capacitor in 22 nm Tri-Gate CMOS
    Jain, R. ; Geuskens, B. M. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-04-01), Heft 4, S. 917-927
    Online academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    An Energy-Efficient Graphics Processor in 14-nm Tri-Gate CMOS Featuring Integrated Voltage Regulators for Fine-Grain DVFS, Retentive Sleep, and ${V}_{\text{MIN}}$ Optimization
    Meinerzhagen, P.A. ; Tokunaga, C. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 54 (2019), Heft 1, S. 144-157
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  16. Detailansicht für Treffer 16 öffnen
    Dynamic Integrated MPP Tracker in 0.35 μm CMOS
    Enne, R. ; Nikolic, M. ; et al.
    In: IEEE Transactions on Power Electronics, Jg. 28 (2013-06-01), Heft 6, S. 2886-2894
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    A 20 Gb/s Clock and Data Recovery With a Ping-Pong Delay Line for Unlimited Phase Shifting in 65 nm CMOS Process
    Kwak, Y. H. ; Kim, Y. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 60 (2013-02-01), Heft 2, S. 303-313
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    An All-Digital Fully Integrated Inductive Buck Regulator With A 250-MHz Multi-Sampled Compensator and a Lightweight Auto-Tuner in 130-nm CMOS
    Kar, M. ; Singh, A. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 52 (2017-07-01), Heft 7, S. 1825-1835
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    A 6-Gbit/s Hybrid Voltage-Mode Transmitter With Current-Mode Equalization in 90-nm CMOS
    Song, Y. H. ; Palermo, S.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 59 (2012-08-01), Heft 8, S. 491-495
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    A 2 Tb/s 6$\,\times\,$ 4 Mesh Network for a Single-Chip Cloud Computer With DVFS in 45 nm CMOS
    Salihundam, P. ; Jain, S. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-04-01), Heft 4, S. 757-766
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