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    A Low-Noise Multi-GHz CMOS Multiloop Ring Oscillator With Coarse and Fine Frequency Tuning
    HAI QI, LIU ; WANG LING, GOH ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 17 (2009), Heft 4, S. 571-577
    Online academicJournal
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    28-GHz CMOS VCO With Capacitive Splitting and Transformer Feedback Techniques for 5G Communication.
    Fu, Yupeng ; Li, Lianming ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 27 (2019-09-01), Heft 9, S. 2088-2095
    Online academicJournal
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    Dieser Titel kann aus lizenzrechtlichen Gründen nur im Campusnetz oder nach Anmeldung angezeigt werden!
    academicJournal
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    A 14-GHz AC-Coupled Clock Distribution Scheme With Phase Averaging Technique Using Single LC-VCO and Distributed Phase Interpolators
    NIITSU, Kiichi ; KULKARNI, Vishal V ; et al.
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 19 (2011), Heft 11, S. 2058-2066
    Online academicJournal
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    A Multiband VCO Using a Switched Series Resonance for Fine Frequency Tuning Sensitivity and Phase Noise Improvement.
    Mansour, Islam ; Mansour, Marwa ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 29 (2021-12-01), Heft 12, S. 2163-2171
    Online academicJournal
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    A 104-GHz Phase-Locked Loop Using a VCO at Second Pole Frequency
    TSAI, Kun-Hung ; LIU, Shen-Iuan
    In: IEEE transactions on very large scale integration (VLSI) systems, Jg. 20 (2012), Heft 1, S. 80-88
    Online academicJournal
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    Frequency-Tuning Negative-Conductance Boosted Structure and Applications for Low-Voltage Low-Power Wide-Tuning-Range VCO.
    Wang, To-Po ; Wang, Shih-Yu
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015-06-01), Heft 6, S. 1137-1144
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    A Wide-Range Multiport LC-Ladder Oscillator and Its Applications to a 1.2–10.1 GHz PLL.
    Huang, Po-Chiun ; Shen, Meng-Hung
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 23 (2015), Heft 1, S. 184-188
    Online academicJournal
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    A 3.3-GHz Integer N-Type-II Sub-Sampling PLL Using a BFSK-Suppressed Push–Pull SS-PD and a Fast-Locking FLL Achieving −82.2-dBc REF Spur and −255-dB FOM.
    Yang, Zunsong ; Chen, Yong ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 30 (2022-02-01), Heft 2, S. 238-242
    Online academicJournal
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    Spur-Reduction Frequency Synthesizer Exploiting Randomly Selected PFD.
    Liao, Te-Wen ; Su, Jun-Ren ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-03-01), Heft 3, S. 589-592
    Online academicJournal
    Zugriff:
    Volltext
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