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    Patent Issued for Electrostatic discharge (ESD) protection for CMOS circuits (USPTO 11876089).
    In: Computer Weekly News, 2024-02-07, S. 4051
    Zeitungsartikel
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    Patent Issued for Thin-film-transistor based complementary metal-oxide-semiconductor (CMOS) circuit (USPTO 11659722).
    In: Technology News Focus, 2023-06-14, S. 6063
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for Graphene LHFETS (lateral heterostructure field effect transistors) on SI compatible with CMOS BEOL process (USPTO 11569367).
    In: Journal of Technology & Science, 2023-02-26, S. 3669
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for Integrated device comprising a CMOS structure comprising well-less transistors (USPTO 11502079).
    In: Telecommunications Weekly, 2022-12-07, S. 1326
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for Circuits employing a back side-front side connection structure for coupling back side routing to front side routing, and related complementary metal oxide semiconductor (CMOS) circuits and methods (USPTO 11404374).
    In: Telecommunications Weekly, 2022-08-24, S. 1131
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for Heterogeneous Ge/III-V CMOS transistor structures (USPTO 11398479).
    In: Technology News Focus, 2022-08-17, S. 5635
    Zeitungsartikel
    Wie komme ich dran?
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    Patent Issued for Ferroelectric-capacitor integration using novel multi-metal-level interconnect with replaced dielectric for ultra-dense embedded SRAM in state-of-the-art CMOS technology (USPTO 11322504).
    In: Journal of Technology & Science, 2022-05-29, S. 3976
    Zeitungsartikel
    Wie komme ich dran?
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    Researchers from Tokyo Institute of Technology Discuss Findings in Electronics (64qam Wireless Link With 300 Ghz Inp-cmos Hybrid Transceiver).
    In: Telecommunications Weekly, 2021-11-24, S. 77
    Zeitungsartikel
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    Patent Issued for Distinct Gate Stacks For III-V-Based CMOS Circuits Comprising A Channel Cap (USPTO 10,593,600).
    In: Investment Weekly News, 2020-04-04, S. 4292
    Zeitungsartikel
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  10. Detailansicht für Treffer 10 öffnen
    Patent Issued for Integrated CMOS Transmit/Receive Switch In A Radio Frequency Device (USPTO 10,581,388).
    In: Investment Weekly News, 2020-03-21, S. 5747
    Zeitungsartikel
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  11. Detailansicht für Treffer 11 öffnen
    Patent Application Titled "Reducing Off-State Leakage Current In Si/SiGe Dual Channel CMOS" Published Online (USPTO 20200066600).
    In: Investment Weekly News, 2020-03-21, S. 3685
    Zeitungsartikel
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  12. Detailansicht für Treffer 12 öffnen
    Patent Issued for CMOS Externally Modulated Laser Driver (USPTO 10,574,023).
    In: Technology Business Journal, 2020-03-10, S. 3001
    Zeitungsartikel
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    Patent Issued for Porous Silicon Relaxation Medium For Dislocation Free CMOS Devices (USPTO 10,541,177).
    In: Investment Weekly News, 2020-02-08, S. 4968
    Zeitungsartikel
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  14. Detailansicht für Treffer 14 öffnen
    Researchers Submit Patent Application, "Integrated CMOS Source Drain Formation With Advanced Control", for Approval (USPTO 20200013878).
    In: Investment Weekly News, 2020-02-01, S. 6339
    Zeitungsartikel
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    Patent Issued for Gate Stack Designs For Analog And Logic Devices In Dual Channel Si/SiGe CMOS (USPTO 10,535,517).
    In: Technology Business Journal, 2020-01-28, S. 4069
    Zeitungsartikel
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    Patent Issued for CMOS VFET Contacts With Trench Solid And Liquid Phase Epitaxy (USPTO 10,510,617).
    In: Technology Business Journal, 2019-12-31, S. 3203
    Zeitungsartikel
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    Patent Issued for Linearly Weight Updatable CMOS Synaptic Array Without Cell Location Dependence (USPTO 10,490,273).
    In: Investment Weekly News, 2019-12-14, S. 4772
    Zeitungsartikel
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    Patent Issued for VFET CMOS Dual Epitaxy Integration (USPTO 10,468,525).
    In: Investment Weekly News, 2019-11-23, S. 6588
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    Patent Issued for Fringe Capacitance Reduction For Replacement Gate CMOS (USPTO 10,439,041).
    In: Investment Weekly News, 2019-10-26, S. 5097
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  20. Detailansicht für Treffer 20 öffnen
    Researchers Submit Patent Application, "Gate Stack Designs For Analog And Logic Devices In Dual Channel Si/SiGe CMOS", for Approval (USPTO 20190295844).
    In: Investment Weekly News, 2019-10-19, S. 7706
    Zeitungsartikel
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