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    Nonvolatile online CMOS trimming with magnetic tunnel junctions
    Dutta, Sumit ; Price, Michael ; et al.
    In: 2016 IEEE/ACM International Symposium on Nanoscale Architectures (NANOARCH), 2016-07-01, S. 61-66
    Konferenz
    Wie komme ich dran?
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    A 46.6 μg/√Hz Single-Chip Accelerometer Exploiting a DTC-Assisted Chopper Amplifier
    Li, X. ; Chung, V.P.J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 59 (2024-02-01), Heft 2, S. 502-515
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Energy Efficiency Versus Clock Slope
    Alioto, Massimo ; Consoli, Elio ; et al.
    In: Flip-Flop Design in Nanometer CMOS : From High Speed to Low Energy; (2015) S. 175-198
    Online E-Book
    Wie komme ich dran?
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    25.7 Time-Borrowing Fast Mux-D Scan Flip-Flop with On-Chip Timing/Power/VMIN Characterization Circuits in 10nm CMOS
    Mathew, Sanu ; Chen, Gregory K. ; et al.
    In: 2020 IEEE International Solid- State Circuits Conference - (ISSCC), 2020-02-01
    Online unknown
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    Wie komme ich dran?
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    A 50% CMOS Duty Cycle Repeater(DCR)Using Complementary Phase Blending / 相補位相ブレンド方式によるデューティ50%補償CMOSリピータ
    Nakamura, Kazuyuki ; Yotsuyanagi, Michio ; et al.
    2000
    academicJournal
    Wie komme ich dran?
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    Design of High Performance Low Power Microprocessors
    Nawathe, Umesh Gajanan ; Iniewski, Krzysztof [Ed.]
    In: CMOS Processors and Memories; (2010) S. 3-27
    Online E-Book
    Wie komme ich dran?
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    A 10-Gb/s 0.71-pJ/bit Forwarded-Clock Receiver Tolerant to High-Frequency Jitter in 65-nm CMOS
    Kim, Lee-Sup ; Kim, Young-Ju ; et al.
    In: IEEE Transactions on Circuits and Systems II: Express Briefs, Jg. 63 (2016-03-01), S. 264-268
    Online unknown
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    Global clock distribution on standing wave with CMOS active inductor loading
    Yang, Jing ; Kim, Yong-Bin
    In: 2017 IEEE 60th International Midwest Symposium on Circuits and Systems (MWSCAS), 2017-08-01
    Online unknown
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    A 340 mV-to-0.9 V 20.2 Tb/s Source-Synchronous Hybrid Packet/Circuit-Switched 16 × 16 Network-on-Chip in 22 nm Tri-Gate CMOS
    Borkar, Shekhar ; Mathew, Sanu ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015), S. 59-67
    Online unknown
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  10. Detailansicht für Treffer 10 öffnen
    True Single Phase Clocking Flip-Flop Design using Multi Threshold CMOS Technique
    Sharma, Priyanka ; Mehra, Rajesh
    In: International Journal of Computer Applications, Jg. 96 (2014-06-18), S. 44-51
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  11. Detailansicht für Treffer 11 öffnen
    A 4GHz clock distribution architecture using subharmonically injection-locked coupled oscillators with clock skew calibration in 16nm CMOS
    Liu, Jack ; Feng Wei Kuo ; et al.
    In: 2017 Symposium on VLSI Circuits, 2017-06-01
    Online unknown
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  12. Detailansicht für Treffer 12 öffnen
    A 10Gbps half-rate digital clock and data recovery circuit for 60GHz receiver in 65nm CMOS
    Chi, Baoyong ; Liu, Zhi-Ran ; et al.
    In: 2016 13th IEEE International Conference on Solid-State and Integrated Circuit Technology (ICSICT), 2016-10-01
    Online unknown
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    A 3.4-Gbps clock and data recovery circuit with a forwarded clock in a 0.13-μm CMOS technology
    Han, Woosang ; Kim, Ook ; et al.
    In: International Journal of Electronics Letters, Jg. 1 (2013-06-01), S. 77-86
    Online unknown
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  14. Detailansicht für Treffer 14 öffnen
    A Compact Clock Generator for Heterogeneous GALS MPSoCs in 65-nm CMOS Technology
    Walter, Dennis ; Henker, Stephan ; et al.
    In: IEEE Transactions on Very Large Scale Integration (VLSI) Systems, Jg. 21 (2013-03-01), S. 566-570
    Online unknown
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    A Fast Phase Tracking ADPLL for Video Pixel Clock Generation in 65 nm CMOS Technology
    Ko, Chiun-Yao ; Chung, Ching-Che
    In: IEEE Journal of Solid-State Circuits, Jg. 46 (2011-10-01), S. 2300-2311
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    A Dual-Loop Clock and Data Recovery Circuit With Compact Quarter-Rate CMOS Linear Phase Detector
    Kiat Seng Yeo ; Manh Anh Do ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 59 (2012-06-01), S. 1156-1167
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  17. Detailansicht für Treffer 17 öffnen
    A 25-Gb/s 5-mW CMOS CDR/Deserializer
    Jun Won Jung ; Razavi, Behzad
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013-03-01), S. 684-697
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  18. Detailansicht für Treffer 18 öffnen
    SleepWalker: A 25-MHz 0.4-V Sub-$\hbox{mm}^{2}$ 7-$\mu\hbox{W/MHz}$ Microcontroller in 65-nm LP/GP CMOS for Low-Carbon Wireless Sensor Nodes
    Boyd, Sarah ; Flandre, Denis ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 48 (2013), S. 20-32
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    Design of CMOS GHz Cellular Oscillator/Distributor Network with Supply Voltage and Ambient Temperature Insensitivities
    Moon, Gyu ; Choi, Won-yong ; et al.
    In: Advanced Science and Technology Letters, 2015-04-15
    Online unknown
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    Power efficient dual dynamic flip-flop design featuring embedded logic using CMOS technology
    Karule, P. T. ; Tirpude, Sonal D.
    In: 2015 International Conference on Communications and Signal Processing (ICCSP), 2015-04-01
    Online unknown
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