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    mm-Wave CMOS Device Optimization Design for Super-400 GHz fMAX with Impact of Technology Scaling and Layout Dependent Effects
    Guo, Jyh-Chyurn ; Wijaya, Adhi Cahyo ; et al.
    In: 2023 Asia-Pacific Microwave Conference (APMC), 2023-12-05, S. 246-249
    Konferenz
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    A 2X2 0.232-0.243 THz coherent scalable array in 28nm CMOS
    Londhe, Sumeet ; Socher, Eran
    In: 2023 53rd European Microwave Conference (EuMC), 2023-09-19, S. 70-73
    Konferenz
    Wie komme ich dran?
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    Design and Validation of Domino CMOS D Flip Flop at 16nm Regime
    Kishore, Pinninti ; Kacharla, Sanjay ; et al.
    In: 2023 3rd International Conference on Advancement in Electronics & Communication Engineering (AECE), 2023-11-23, S. 440-444
    Konferenz
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    CFET SRAM DTCO, Interconnect Guideline, and Benchmark for CMOS Scaling
    Liu, H. ; Salahuddin, S.M. ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 70 (2023-03-01), Heft 3, S. 883-890
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Improved Air Spacer for Highly Scaled CMOS Technology
    Cheng, K. ; Park, C. ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 67 (2020-12-01), Heft 12, S. 5355-5361
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Reliability Analysis of Nano-CMOS Logic Gates Under Process Induced Variations
    Vemuru, Srinivasa ; Vittala, Sandeep
    In: NAECON 2018 - IEEE National Aerospace and Electronics Conference, 2018-07-01, S. 350-355
    Konferenz
    Wie komme ich dran?
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    Chip Power Scaling in Recent CMOS Technology Nodes
    Shahidi, G.G.
    In: IEEE Access, Jg. 7 (2019), S. 851-856
    Online academicJournal
    Zugriff:
    Volltext
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    Vertical-Transport Nanosheet Technology for CMOS Scaling beyond Lateral-Transport Devices
    Jagannathan, H. ; Anderson, B. ; et al.
    In: 2021 IEEE International Electron Devices Meeting (IEDM), 2021-12-11, S. 1
    Konferenz
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  9. Detailansicht für Treffer 9 öffnen
    A Linearity Enhancement Technique for Cascode Opamp in 65nm CMOS Technology
    Nagulapalli, R. ; Sridevi, Sriadibhatla ; et al.
    In: 2018 International Conference on Current Trends towards Converging Technologies (ICCTCT), 2018-03-01, S. 1-5
    Konferenz
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  10. Detailansicht für Treffer 10 öffnen
    Scaling Potential Analysis for the CMOS Compatible Ox-RRAM
    Xu, Xiaoxin ; Sun, Wenxuan ; et al.
    In: 2021 IEEE International Memory Workshop (IMW), 2021-05-01, S. 1-4
    Konferenz
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  11. Detailansicht für Treffer 11 öffnen
    Status and Future Prospects of CMOS Scaling and Moore's Law - A Personal Perspective
    Schwierz, Frank ; Liou, Juin J.
    In: 2020 IEEE Latin America Electron Devices Conference (LAEDC), 2020-02-01, S. 1-4
    Konferenz
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  12. Detailansicht für Treffer 12 öffnen
    Time-Based Sensor Interface Circuits in CMOS and Carbon Nanotube Technologies
    Gielen, G. ; Van Rethy, J. ; et al.
    In: IEEE Transactions on Circuits and Systems I: Regular Papers, Jg. 63 (2016-05-01), Heft 5, S. 577-586
    Online academicJournal
    Zugriff:
    Volltext
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  13. Detailansicht für Treffer 13 öffnen
    Nanoscale memristors: Devices engineering, CMOS integration and novel applications
    Xia, Qiangfei
    In: 2015 IEEE International Conference on Digital Signal Processing (DSP), 2015-07-01, S. 1216-1218
    Konferenz
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  14. Detailansicht für Treffer 14 öffnen
    Effect of Process Variation on Power and Delay in CMOS Circuits
    Kamdi, Ghanshyam ; Deotale, Trushna
    In: 2013 International Conference on Communication Systems and Network Technologies, 2013-04-01, S. 748-752
    Konferenz
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  15. Detailansicht für Treffer 15 öffnen
    A High-Power and Scalable 2-D Phased Array for Terahertz CMOS Integrated Systems
    Tousi, Y. ; Afshari, E.
    In: IEEE Journal of Solid-State Circuits, Jg. 50 (2015-02-01), Heft 2, S. 597-609
    Online academicJournal
    Zugriff:
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  16. Detailansicht für Treffer 16 öffnen
    Switched-Mode Operational Amplifiers and Their Application to Continuous-Time Filters in Nanoscale CMOS
    Vigraham, B. ; Kuppambatti, J. ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 49 (2014-12-01), Heft 12, S. 2758-2772
    Online academicJournal
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    Volltext
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  17. Detailansicht für Treffer 17 öffnen
    Analog performance of advanced CMOS in weak, moderate, and strong inversion
    Bucher, Matthias ; Diles, George ; et al.
    In: Proceedings of the 17th International Conference Mixed Design of Integrated Circuits and Systems - MIXDES 2010, 2010-06-01, S. 54-57
    Konferenz
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  18. Detailansicht für Treffer 18 öffnen
    Temperature scaling of CMOS analog design parameters
    Makris, Nikos ; Bucher, Matthias
    In: 2012 16th IEEE Mediterranean Electrotechnical Conference, 2012-03-01, S. 187-190
    Konferenz
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  19. Detailansicht für Treffer 19 öffnen
    Dual-k HfO2 Spacer Bulk Planar Junctionless Transistor for Sub-30 nm Low Power CMOS
    Ramarao, Garike ; Ghosekar, Ishan C. ; et al.
    In: 2017 14th IEEE India Council International Conference (INDICON), 2017-12-01, S. 1-4
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  20. Detailansicht für Treffer 20 öffnen
    CMOS Small-Signal and Thermal Noise Modeling at High Frequencies
    Antonopoulos, A. ; Bucher, M. ; et al.
    In: IEEE Transactions on Electron Devices, Jg. 60 (2013-11-01), Heft 11, S. 3726-3733
    Online academicJournal
    Zugriff:
    Volltext
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