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    A 0.6 V Fast-Transient-Response 180 nm CMOS Digital LDO with Coarse-Fine Tuning and Analog Enhancement.
    Zhang, Kaiqiang ; Tong, Xingyuan
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-11-01), Heft 11, S. 6513-6529
    Online academicJournal
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    Low Power LC-Quadrature VCO with Superior Phase Noise Performance in 0.13 µm RF-CMOS Process for Modern WLAN Application.
    Khan, Imran Ullah ; Balodi, Deepak ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-05-01), Heft 5, S. 2522-2540
    Online academicJournal
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  3. Detailansicht für Treffer 23 öffnen
    Design and Implementation of a Wide-Swing CMOS Multiplier for AC Source Signal Tracking and Modulation.
    Wang, Wei ; Xu, Sendren Sheng-Dong ; et al.
    In: Circuits, Systems & Signal Processing, 2024-05-20, S. 1
    Online academicJournal
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  4. Detailansicht für Treffer 24 öffnen
    Wideband Inductorless True Time Delay Cell Based on CMOS Inverter for Timed Array Receivers.
    Yarahmadi, Ahmad ; Jannesari, Abumoslem
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-08-01), Heft 8, S. 3703-3726
    Online academicJournal
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  5. Detailansicht für Treffer 25 öffnen
    A New Low Power Mixed-Signal Digital Voltage Mode CMOS Fuzzy Logic Controller.
    Ghasemzadeh, Mehdi ; Hadidi, Khayrollah
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-02-01), Heft 2, S. 738-755
    Online academicJournal
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  6. Detailansicht für Treffer 26 öffnen
    Complementary Current-Reused 3.7–11.9 GHz LNA Using Body-Floating and Self-Bias Technique for Sub-6 GHz 5G Communications.
    Chang, Jin-Fa ; Lin, Yo-Sheng
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-11-01), Heft 11, S. 5968-5989
    Online academicJournal
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  7. Detailansicht für Treffer 27 öffnen
    Design of High Linearity Inductor-Less Active CMOS Mixer Based on Volterra Series Analysis.
    Ataei Siah Bidi, Ali ; Karimi, Gholamreza
    In: Circuits, Systems & Signal Processing, Jg. 39 (2020-10-01), Heft 10, S. 4810-4828
    Online academicJournal
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  8. Detailansicht für Treffer 28 öffnen
    A 1 μs Locking Time Dual Loop ADPLL with Foreground Calibration-Based 6 ps Resolution Flash TDC in 180 nm CMOS.
    Sahani, Jagdeep Kaur ; Singh, Anil ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-03-01), Heft 3, S. 1299-1323
    Online academicJournal
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  9. Detailansicht für Treffer 29 öffnen
    Entropy Sources from Tunnelling in Standard CMOS Structures.
    Keledjian, Julian ; Lehmann, Torsten
    In: Circuits, Systems & Signal Processing, 2024-04-18, S. 1
    Online academicJournal
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  10. Detailansicht für Treffer 30 öffnen
    A 170 MHz to 330 MHz Wideband 90 nm CMOS RC–CR Phase Shifter with Integrated On-Line Amplitude Locked Loop Calibration for Hartley Image Rejection Transceiver.
    Zhang, Xiaomeng ; Li, Shuo ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-11-01), Heft 11, S. 5249-5263
    Online academicJournal
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  11. Detailansicht für Treffer 31 öffnen
    A Wideband High Linearity and Low-Noise CMOS Active Mixer Using the Derivative Superposition and Noise Cancellation Techniques.
    Solati, Pouya ; Yavari, Mohammad
    In: Circuits, Systems & Signal Processing, Jg. 38 (2019-07-01), Heft 7, S. 2910-2930
    Online academicJournal
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  12. Detailansicht für Treffer 32 öffnen
    A New Circuit-Level Technique for Leakage and Short-Circuit Power Reduction of Static Logic Gates in 22-nm CMOS Technology.
    Moradinezhad Maryan, Mohammad ; Amini-Valashani, Majid ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-07-01), Heft 7, S. 3536-3560
    Online academicJournal
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  13. Detailansicht für Treffer 33 öffnen
    A 27-1, 20-Gb/s, Low-Power, Charge-Steering Half-Rate PRBS Generator in 1.2 V, 65 nm CMOS.
    Govindaswamy, Prema Kumar ; Pasupureddi, Vijaya Sankara Rao
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-11-01), Heft 11, S. 5553-5571
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  14. Detailansicht für Treffer 34 öffnen
    2×VDD 500 MHz Digital Output Buffer with Optimal Driver Transistor Sizing for Slew Rate Self-adjustment and Leakage Reduction Using 28-nm CMOS Process.
    Wang, Chua-Chin ; Lou, Pang-Yen ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-06-01), Heft 6, S. 2824-2840
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  15. Detailansicht für Treffer 35 öffnen
    65-nm CMOS Voltage-to-Time Converter for 5-GS/s Time-Based ADCs.
    Macpherson, Andrew ; Belostotski, Leonid ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 34 (2015-10-01), Heft 10, S. 3121-3145
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  16. Detailansicht für Treffer 36 öffnen
    A Power-Efficient SAR ADC with Optimized Timing-Redistribution Asynchronous SAR Logic in 40-nm CMOS.
    Hu, Mengying ; Jin, Jing ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-07-01), Heft 7, S. 3125-3142
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  17. Detailansicht für Treffer 37 öffnen
    32-Gb/s NRZ and 40-Gb/s PAM-4 Transimpedance Amplifier Paralleling with a Differentiator for Bandwidth Enhancement in 90-nm CMOS Technology.
    Jou, Jau-Ji ; Shih, Tien-Tsorng ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 41 (2022-02-01), Heft 2, S. 621-635
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  18. Detailansicht für Treffer 38 öffnen
    Modular Discrete and CMOS Integrated Implementations of High-Speed Analog Rank-Order Filters.
    Ramírez-Angulo, Jaime ; Díaz-Sánchez, A. ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 37 (2018-12-01), Heft 12, S. 5637-5646
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  19. Detailansicht für Treffer 39 öffnen
    A New Low-Power Charge Pump with a Glitch-Free PFD for Speedup the Acquisition Process of a PLL in 65 nm CMOS Technology.
    Ghasemian, Hossein ; Bahrami, Amin ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 40 (2021-06-01), Heft 6, S. 2982-3006
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  20. Detailansicht für Treffer 40 öffnen
    An 8-bit, 10 KS/s, $$1.87\upmu \text {W}$$ Successive Approximation Analog to Digital Converter in $$0.25\,\upmu \hbox {m}$$ CMOS Technology for ECG Detection Systems.
    Mahmoud, Soliman ; Salem, Heba ; et al.
    In: Circuits, Systems & Signal Processing, Jg. 34 (2015-08-01), Heft 8, S. 2419-2439
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