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    Cmos design of Ka-Band power amplifier for satellite applications
    Mudgal, Aditya ; Patel, Janak B ; et al.
    In: International Journal of Engineering, Science and Mathematics, Jg. 6 (2017-11-01), Heft 7, S. 62-67
    academicJournal
    Wie komme ich dran?
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    Technique for Designing High Speed Noise Immune CMOS Domino High Fan-in Circuits
    Lakshmi, A. Chaitanya ; Nausheen, Saba ; et al.
    In: International Journal of Engineering and Management Research (IJEMR), Jg. 7 (2017-09-10), Heft 5, S. 178-190
    academicJournal
    Wie komme ich dran?
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    CMOS-MEMS Electroacoustic Micro-Transducers
    Rufer, Libor
    In: Journal of Innovation in Electronics and Communication Engineering, Jg. 6 (2016-07-12), Heft 2, S. 1-6
    academicJournal
    Wie komme ich dran?
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    Combined Logic 32-Bit Carry Select Adder by using Dominos CMOS Logic
    Chowdary, S. Narendra ; Rao, D. Vara Prasada
    In: International Journal of Engineering and Management Research (IJEMR), Jg. 4 (2014-12-01), Heft 6, S. 120-124
    academicJournal
    Wie komme ich dran?
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    Forward Body Biasing Technique in Current Folded CMOS LNA in Subthreshold Region for Biomedical Applications
    Yasami, Saeid ; Bayoumi, Magdy
    In: International Journal of Scientific Engineering and Technology, Jg. 3 (2014-12-01), Heft 12, S. 1441-1448
    academicJournal
    Wie komme ich dran?
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    Modelling of Hybrid CMOS-SET based Highly Efficient Parallel-In Serial-Out Shift Register for Next Generation Electronics
    Gope, Jayanta ; Jha, Raghav Kumar ; et al.
    In: International Journal of Engineering and Management Research (IJEMR), Jg. 4 (2014-06-01), Heft 3, S. 46-51
    academicJournal
    Wie komme ich dran?
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    Comparative study of mosfet, cmos & finfetbase
    Ramakant ; Singh, Raghvendra
    In: International Journal of Management, IT and Engineering, Jg. 9 (2019-06-01), Heft 6, S. 179-192
    academicJournal
    Wie komme ich dran?
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    Co-Design of CMOS Low Noise Amplifier with Patch Antenna for RF Transceiver System
    Gupta, Preeti ; Kumar, Sandeep ; et al.
    In: International Journal of Engineering and Management Research (IJEMR), Jg. 5 (2015-04-01), Heft 2, S. 518-521
    academicJournal
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    Implementation of low power CMOS design using Adiabatic Improved Efficient Charge Recovery Logic
    Kumar, Sanjeev ; Hinnwar, Murlimanohar
    In: International Journal of Scientific Engineering and Technology, Jg. 3 (2014-02-01), Heft 2, S. 150-153
    academicJournal
    Wie komme ich dran?
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    CMOS Based Current Mode Defuzzifier Circuit for Analog Fuzzy Inference System
    Abdulla, K P ; Azeem, Mohammad Fazle
    In: Journal of Innovation in Electronics and Communication Engineering, Jg. 3 (2013-07-12), Heft 2, S. 1-5
    academicJournal
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  11. Detailansicht für Treffer 11 öffnen
    LLP in Chain Inverter by using CMOS Circuit
    Sharma, Ajay ; Khare, C.D. ; et al.
    In: International Journal of Scientific Engineering and Technology, Jg. 1 (2012-10-01), Heft 4, S. 71-75
    academicJournal
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  12. Detailansicht für Treffer 12 öffnen
    Diminishing impacts of various optimization techniques in strong inversion and subthreshold region at 22nm technology node with cmos bulk model
    Sharma, Shobha ; Dev, Amita
    In: Indian Journal of Scientific Research, Jg. 8 (2017-08-01), Heft 1, S. 137-142
    academicJournal
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  13. Detailansicht für Treffer 13 öffnen
    Low Power CMOS Inverter design at different Technologies
    Sharma, Vijay Kumar ; Soni, Surender
    In: International Journal of Applied Engineering Research, Dindigul, Jg. 1 (2010), Heft 3, S. 372-381
    academicJournal
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  14. Detailansicht für Treffer 14 öffnen
    Testing of CMOS OTA Using Combined Oscillation and IDDQ Test Methodology
    Kaur, Maninder ; Kaur, Jasdeep
    In: International Journal of Scientific Engineering and Technology, Jg. 5 (2016-10-01), Heft 10, S. 471-476
    academicJournal
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  15. Detailansicht für Treffer 15 öffnen
    Design of Accumulate Compare and Select Unit of Viterbi Decoder at Reduced CMOS Process Technology
    Shanmugam, Yamini ; Mangalam, H.
    In: Asian Journal of Research in Social Sciences and Humanities, Jg. 7 (2017-02-01), Heft 2, S. 155-159
    academicJournal
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  16. Detailansicht für Treffer 16 öffnen
    Design and Analysis of Scalable Digital CMOS Comparator Using a Parallel Prefix Tree in VDSM (Very Deep Sub Micron) Technology
    Ramanareddy, M. ; Chennakesavalu, M. ; et al.
    In: Journal of Innovation in Electronics and Communication Engineering, Jg. 4 (2014-07-12), Heft 2, S. 46-55
    academicJournal
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  17. Detailansicht für Treffer 17 öffnen
    Design and Performance analysis of CMOS based 7T SRAM using BIST Architecture
    Rao, V Deepika ; Bhagyavathi, V K
    In: International Journal in IT & Engineering, Jg. 4 (2016-05-01), Heft 5, S. 118-124
    academicJournal
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  18. Detailansicht für Treffer 18 öffnen
    Comparative Analysis of Transimpedance Amplifier of 45 nm and 180nm CMOS Technology
    Raut, Akshata ; Bhagat, Narendra ; et al.
    In: International Journal of Scientific Engineering and Technology, Jg. 2 (2013-10-01), Heft 10, S. 1022-1025
    academicJournal
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  19. Detailansicht für Treffer 19 öffnen
    A High Speed CMOS Parallel Counter Using Pipeline Partitioning
    Thamaraiselvan, K. ; Gayathri, C. ; et al.
    In: International Journal of Engineering Research, Jg. 2 (2013-12-01), Heft 8, S. 491-495
    academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    Investigation of Electromagnetic Interference in Cmos Power Distribution Networks.
    Lakshminarasimhacharyulu, M. ; sarma, .Murthy ; et al.
    In: International Journal of Engineering Research, Jg. 2 (2013-11-01), Heft 7, S. 424-431
    academicJournal
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