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    A 30-GHz Class-F Quadrature DCO Using Phase Shifts Between Drain–Gate–Source for Low Flicker Phase Noise and I/Q Exactness
    Chen, Xi ; Hu, Yizhe ; et al.
    In: IEEE journal of solid-state circuits, Jg. 58 (2023), Heft 7, S. 1945-1958
    Online serialPeriodical
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    Volltext
    Wie komme ich dran?
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    A Low-Jitter Ring-DCO-Based Fractional-N Digital PLL With a 1/8 DTC-Range-Reduction Technique Using a Quadruple-Timing-Margin Phase Selector
    Park, Hangi ; Hwang, Chanwoong ; et al.
    In: IEEE journal of solid-state circuits, Jg. 57 (2022), Heft 12, S. 3527-3537
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
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    A Low-Jitter and Low-Fractional-Spur Ring-DCO-Based Fractional- N Digital PLL Using a DTC’s Second-/Third-Order Nonlinearity Cancellation and a Probability-Density-Shaping ΔΣM
    Hwang, Chanwoong ; Park, Hangi ; et al.
    In: IEEE journal of solid-state circuits, Jg. 57 (2022), Heft 9, S. 2841-2855
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
  4. Detailansicht für Treffer 4 öffnen
    A 12-GHz Reconfigurable Multicore CMOS DCO, With a Time-Variant Analysis of the Impact of Reconfiguration Switches on Phase Noise
    Tomasin, Lorenzo ; Andreani, Pietro ; et al.
    In: IEEE journal of solid-state circuits, Jg. 57 (2022), Heft 9, S. 2802-2811
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
  5. Detailansicht für Treffer 5 öffnen
    A 12-GHz Reconfigurable Multicore CMOS DCO, With a Time-Variant Analysis of the Impact of Reconfiguration Switches on Phase Noise
    ANDREA, BEVILACQUA ; Padovan, Fabio ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-09-01), S. 2802-2811
    Online unknown
    Zugriff:
    View record in OpenAIRE (Volltext)
    Volltext
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    A Single-Pin Antenna Interface RF Front End Using a Single-MOS DCO-PA and a Push–Pull LNA
    Xu, Kai ; Yin, Jun ; et al.
    In: IEEE journal of solid-state circuits, Jg. 55 (2020), Heft 8, S. 2055-2068
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
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    Dieser Titel kann aus lizenzrechtlichen Gründen nur im Campusnetz oder nach Anmeldung angezeigt werden!
    academicJournal
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    A 320-fs RMS Jitter and – 75-dBc Reference-Spur Ring-DCO-Based Digital PLL Using an Optimal-Threshold TDC
    Seong, Taeho ; Lee, Yongsun ; et al.
    In: IEEE journal of solid-state circuits, Jg. 54 (2019), Heft 9, S. 2501-2512
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
  9. Detailansicht für Treffer 9 öffnen
    A 0.85mm 2 51%-Efficient 11-dBm Compact DCO-DPA in 16-nm FinFET for Sub-Gigahertz IoT TX Using HD<subscript>2</subscript> Self-Suppression and Pulling Mitigation
    Xu, Kai ; Kuo, Feng-Wei ; et al.
    In: IEEE journal of solid-state circuits, Jg. 54 (2019), Heft 7, S. 2028-2037
    Online serialPeriodical
    Zugriff:
    Volltext
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  10. Detailansicht für Treffer 10 öffnen
    Design and Analysis of a DCO-Based Phase-Tracking RF Receiver for IoT Applications
    Purushothaman, Vijaya Kumar ; Bachmann, Christian ; et al.
    In: IEEE journal of solid-state circuits, Jg. 54 (2019), Heft 3, S. 785-795
    Online serialPeriodical
    Zugriff:
    Volltext
    Wie komme ich dran?
  11. Detailansicht für Treffer 11 öffnen
    Design and Analysis of a DCO-Based Phase-Tracking RF Receiver for IoT Applications
    Liu, Yao-Hong ; Purushothaman, Vijaya Kumar ; et al.
    In: IEEE journal of solid-state circuits, Jg. 54 (2019), Heft 3, S. 785-795
    Online serialPeriodical
    Zugriff:
    Volltext
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  12. Detailansicht für Treffer 12 öffnen
    An 82–107.6-GHz Integer-<inline-formula> <tex-math notation='LaTeX'>$N$ </tex-math></inline-formula> ADPLL Employing a DCO With Split Transformer and Dual-Path Switched-Capacitor Ladder and a Clock-Skew-Sampling Delta–Sigma TDC
    Huang, Zhiqiang ; Luong, Howard C.
    In: IEEE journal of solid-state circuits, Jg. 54 (2019), Heft 2, S. 358-367
    Online serialPeriodical
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    Volltext
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  13. Detailansicht für Treffer 13 öffnen
    A 30-GHz Class-F Quadrature DCO Using Phase Shifts Between Drain–Gate–Source for Low Flicker Phase Noise and I/Q Exactness
    Chen, Xi ; Hu, Yizhe ; et al.
    In: IEEE Journal of Solid-State Circuits, 2023, S. 1-14
    Online unknown
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    View record in OpenAIRE (Volltext)
    Volltext
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  14. Detailansicht für Treffer 14 öffnen
    A Low-Jitter Ring-DCO-Based Fractional-N Digital PLL With a 1/8 DTC-Range-Reduction Technique Using a Quadruple-Timing-Margin Phase Selector
    Park, Hangi ; Hwang, Chanwoong ; et al.
    In: IEEE Journal of Solid-State Circuits, Jg. 57 (2022-12-01), S. 3527-3537
    Online unknown
    Zugriff:
    View record in OpenAIRE (Volltext)
    Volltext
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  15. Detailansicht für Treffer 15 öffnen
    A 2.8-3.2-GHz Fractional-N Digital PLL With ADC-Assisted TDC and Inductively Coupled Fine-Tuning DCO
    YAO, Chih-Wei ; WILLSON, Alan N
    In: IEEE journal of solid-state circuits, Jg. 48 (2013), Heft 3, S. 698-710
    Online academicJournal
    Zugriff:
    Volltext
    Wie komme ich dran?
  16. Detailansicht für Treffer 16 öffnen
    A PVT Tolerant 10 to 500 MHz All-Digital Phase-Locked Loop With Coupled TDC and DCO
    WEI, LIU ; WEI, LI ; et al.
    In: IEEE journal of solid-state circuits, Jg. 45 (2010), Heft 2, S. 314-321
    Online academicJournal
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    academicJournal
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    An Architecture for Large-Area Sensor Acquisition Using Frequency-Hopping ZnO TFT DCOs
    Afsar, Yasmin ; Moy, Tiffany ; et al.
    In: IEEE journal of solid-state circuits, Jg. 53 (2017), Heft 1, S. 297-308
    Online serialPeriodical
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    academicJournal
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    Dieser Titel kann aus lizenzrechtlichen Gründen nur im Campusnetz oder nach Anmeldung angezeigt werden!
    academicJournal
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