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    Wide Tunning Range 60 GHz VCO and 40 GHz DCO Using Single Variable Inductor.
    Lu, Tai-You ; Yu, Chi-Yao ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 60 (2013-02-01), Heft 2, S. 257-267
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    Multi-Rate DEM With Mismatch-Noise Cancellation for DCOs in Digital PLLs.
    Alvarez-Fontecilla, Enrique ; Venerus, Christian ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-10-01), Heft 10, S. 3125-3137
    Online serialPeriodical
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    A 0.7-V Sub-mW Type-II Phase-Tracking Bluetooth Low Energy Receiver in 28-nm CMOS.
    Hu, Suoping ; Chen, Peng ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-06-01), Heft 6, S. 2317-2328
    Online serialPeriodical
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    An All-Digital PLL for Cellular Mobile Phones in 28-nm CMOS with −55 dBc Fractional and −91 dBc Reference Spurs.
    Kuo, Feng-Wei ; Babaie, Masoud ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 65 (2018-11-01), Heft 11, S. 3756-3768
    Online serialPeriodical
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    Design and Analysis of Millimeter-Wave Digitally Controlled Oscillators With C-2C Exponentially Scaling Switched-Capacitor Ladder.
    Huang, Zhiqiang ; Luong, Howard C.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-06-01), Heft 6, S. 1299-1307
    Online serialPeriodical
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    A Fast-Locking All-Digital Phase-Locked Loop With Dynamic Loop Bandwidth Adjustment.
    Lin, Jung-Mao ; Yang, Ching-Yuan
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 62 (2015-10-01), Heft 10, S. 2411-2422
    Online serialPeriodical
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    Observer-Controller Digital PLL.
    Namgoong, Won
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 57 (2010-03-01), Heft 3, S. 631-641
    Online serialPeriodical
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    An Interpolating Digitally Controlled Oscillator for a Wide-Range All-Digital PLL.
    Choi, Kwang-Hee ; Shin, Jung-Bum ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 56 (2009-09-01), Heft 9, S. 2055-2063
    Online serialPeriodical
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    Linear Time-Variant Modeling and Analysis of All-Digital Phase-Locked Loops.
    Syllaios, I. L. ; Balsara, P. T.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 59 (2012-11-01), Heft 11, S. 2495-2506
    Online serialPeriodical
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    A 4-GHz All Digital PLL With Low-Power TDC and Phase-Error Compensation.
    Lee, Ja-Yol ; Park, Mi-Jeong ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 59 (2012-08-01), Heft 8, S. 1706-1719
    Online serialPeriodical
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  11. Detailansicht für Treffer 11 öffnen
    A 1-to-2048 Fully-Integrated Cascaded Digital Frequency Synthesizer for Low Frequency Reference Clocks Using Scrambling TDC.
    Nandwana, Romesh Kumar ; Saxena, Saurabh ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-02-01), Heft 2, S. 283-295
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    A 660 MHz–5 GHz 6-Phase/3-Phase Transmitter With Cancellation of Counter-Intermodulation Distortion and Improved Image Rejection.
    Jiang, Hong ; Al-Qaq, Wael ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 68 (2021-04-01), Heft 4, S. 1432-1443
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    A 12-GHz Calibration-Free All-Digital PLL for FMCW Signal Generation With 78 MHz/μs Chirp Slope and High Chirp Linearity.
    Shen, Zhengkun ; Jiang, Haoyun ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-12-01), Heft 12, S. 4445-4456
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  14. Detailansicht für Treffer 14 öffnen
    A Digital PLL With a Stochastic Time-to-Digital Converter.
    Kratyuk, Volodymyr ; Hanumolu, Pavan Kumar ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 56 (2009-08-01), Heft 8, S. 1612-1621
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    A 33-ppm/°C 240-nW 40-nm CMOS Wakeup Timer Based on a Bang-Bang Digital-Intensive Frequency-Locked-Loop for IoT Applications.
    Ding, Ming ; Zhou, Zhihao ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 67 (2020-07-01), Heft 7, S. 2263-2273
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    A Supply-Noise-Insensitive Digitally-Controlled Oscillator.
    Yuan, Chen ; Shekhar, Sudip
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 66 (2019-09-01), Heft 9, S. 3414-3422
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    An Ultra-Low Power 1.7-2.7 GHz Fractional-N Sub-Sampling Digital Frequency Synthesizer and Modulator for IoT Applications in 40 nm CMOS.
    Liu, Yao-Hong ; Van Den Heuvel, Johan ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 64 (2017-05-01), Heft 5, S. 1094-1105
    Online serialPeriodical
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  18. Detailansicht für Treffer 18 öffnen
    Analysis and Design of Low-Jitter Digital Bang-Bang Phase-Locked Loops.
    Marucci, Giovanni ; Levantino, Salvatore ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 61 (2014), Heft 1, S. 26-36
    Online serialPeriodical
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  19. Detailansicht für Treffer 19 öffnen
    An Interpolating Digitally Controlled Oscillator for a Wide-Range All-Digital PLL.
    Choi, Kwang-Hee ; Shin, Jung-Bum ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 56 (2009-09-01), Heft 9, S. 2055-2063
    Online academicJournal
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  20. Detailansicht für Treffer 20 öffnen
    A Frequency-Based Model for Limit Cycle and Spur Predictions in Bang-Bang All Digital PLL.
    Liu, Dan ; Basedau, P. ; et al.
    In: IEEE Transactions on Circuits & Systems. Part I: Regular Papers, Jg. 59 (2012-06-01), Heft 6, S. 1205-1214
    Online serialPeriodical
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