Floating gate analog implementation of the additive soft-input soft-output decoding algorithm

Mondragon-Torres, Antonio F. ; Sanchez-Sinencio, Edgar

In: 2002 IEEE International Symposium on Circuits and Systems. Proceedings (Cat. No.02CH37353), 2003-06-25

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The soft-input soft-output decoding algorithm is used to decode concatenated codes iteratively. To implement this algorithm efficiently, an additive form in the logarithmic domain is employed. A novel analog implementation using CMOS translinear circuits is proposed. A multiple-input floating-gate CMOS transistor working in the subthreshold region is used as the main translinear computing element. The proposed approach allows a direct mapping between the decoding algorithm and the circuit implementation. Experimental CMOS chip results are in good agreement with theoretical and simulation results.

Titel:	Floating gate analog implementation of the additive soft-input soft-output decoding algorithm
Autor/in / Beteiligte Person:	Mondragon-Torres, Antonio F. ; Sanchez-Sinencio, Edgar
Link:	View record in OpenAIRE (Volltext) https://doi.org/10.1109/iscas.2002.1010931
Zeitschrift:	2002 IEEE International Symposium on Circuits and Systems. Proceedings (Cat. No.02CH37353), 2003-06-25
Veröffentlichung:	IEEE, 2003
Medientyp:	unknown
DOI:	10.1109/iscas.2002.1010931
Schlagwort:	Subthreshold conduction Computer science Concatenated error correction code Hardware_PERFORMANCEANDRELIABILITY Serial concatenated convolutional codes Integrated circuit design Sequential decoding Computer Science::Hardware Architecture Computer Science::Emerging Technologies CMOS Hardware_INTEGRATEDCIRCUITS Electronic engineering Hardware_ARITHMETICANDLOGICSTRUCTURES Algorithm Decoding methods Hardware_LOGICDESIGN Computer Science::Information Theory Electronic circuit
Sonstiges:	Nachgewiesen in: OpenAIRE

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