CMOS Design and Analysis of Four-Quadrant Analog Multiplier Circuit for LF Applications

Pandit, Soumya ; Abhishek Kumar Gond

In: Lecture Notes in Electrical Engineering ISBN: 9789811508288; (2019-12-17)

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Low-frequency analog integrated circuit design is a challenging task considering the threat imposed by flicker noise. This paper presents design and analysis of analog multiplier circuit using p-channel MOS transistor, in contrast to the traditional approach of designing using n-channel MOS transistor. Exhaustive simulation using SCL 180 nm process technology is performed. This includes dc, transient, and harmonics analysis. We derive compact analytical model of various performance parameters and compare it with simulation results. Good matching between the two has been obtained. The application of multiplier circuit for demodulation purpose is shown.

Titel:	CMOS Design and Analysis of Four-Quadrant Analog Multiplier Circuit for LF Applications
Autor/in / Beteiligte Person:	Pandit, Soumya ; Abhishek Kumar Gond
Link:	View record in OpenAIRE (Volltext) https://doi.org/10.1007/978-981-15-0829-5_28
Quelle:	Lecture Notes in Electrical Engineering ISBN: 9789811508288; (2019-12-17)
Veröffentlichung:	Springer Singapore, 2019
Medientyp:	unknown
DOI:	10.1007/978-981-15-0829-5_28
Schlagwort:	Computer science Transistor Hardware_PERFORMANCEANDRELIABILITY Quadrant (instrument) Integrated circuit design Analog multiplier law.invention CMOS law Harmonics Hardware_INTEGRATEDCIRCUITS Electronic engineering Demodulation Flicker noise Hardware_LOGICDESIGN
Sonstiges:	Nachgewiesen in: OpenAIRE Rights: CLOSED

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