Einzeltreffer — DigiBib

A trigger track processor is being designed for CDF Run 2. This processor identifies high momentum (P{sub T} > 1.5 GeV/c) charged tracks in the new central outer tracking chamber for the CDF II detector. The design of the track processor, called the eXtremely Fast Tracker (XFT), is highly parallel and handle an input rate of 183 Gbits/sec and output rate of 44 Gbits/sec. The XFT is pipelined and reports the results for a new event every 132ns. The XFT uses three stages, hit classification, segment finding, and segment linking. The pattern recognition algorithms for the three stages are implemented in Programmable Logic Devices (PLDs) which allow for in-situ modification of the algorithm at any time. The PLDs reside on three different types of modules. Prototypes of each of these modules have been designed and built, and are working. An overview of the hardware design and the system architecture are presented.

Titel:	System architecture and hardware design of the CDF XFT online track processor
Autor/in / Beteiligte Person:	Holm, Scott
Link:	http://www.osti.gov/servlets/purl/14365 https://www.osti.gov/biblio/14365 https://doi.org/10.1109/NSSMIC.1999.842491
Veröffentlichung:	2021
Medientyp:	unknown
DOI:	10.1109/NSSMIC.1999.842491
Schlagwort:	43 PARTICLE ACCELERATORS 46 INSTRUMENTATION RELATED TO NUCLEAR SCIENCE AND TECHNOLOGY ALGORITHMS CLASSIFICATION DESIGN FERMILAB COLLIDER DETECTOR MODIFICATIONS PATTERN RECOGNITION DIELECTRIC TRACK DETECTORS PARTICLE TRACKS DATA ACQUISITION SYSTEMS
Sonstiges:	Nachgewiesen in: BASE Sprachen: unknown Collection: SciTec Connect (Office of Scientific and Technical Information - OSTI, U.S. Department of Energy) Document Type: other/unknown material File Description: application/pdf Language: unknown

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System architecture and hardware design of the CDF XFT online track processor