Projektowanie topografii cyfrowych i analogowych układów scalonych CMOS z wykorzystaniem pakietu MagicLayout design process of digital and analog CMOS integrated circuits using Magic system
Online
serialPeriodical
Zugriff:
Przedmiot artykułu stanowią zagadnienia związane z projektowaniem topografii cyfrowych i analogowych układów scalonych CMOS. W pracy przedstawiono charakterystykę pakietu Magic, przy pomocy którego studenci wyższych lat studiów, na Wydziale ETI Politechniki Gdańskiej, projektują - w ramach laboratorium oraz prac dyplomowych - fragmenty topografii układów scalonych, zarówno cyfrowych (bramki, przerzutniki, układy kombinacyjne) jak i analogowych (np. wzmacniacze transkonduktancyjne, filtry aktywne). Szczegółowo omówiono te etapy procesu projektowania, które wykonują studenci, tzn. wstępną symulację komputerową projektu, tworzenie topografii, ekstrakcję oraz analizę post-layoutową. Zaprezentowano przykłady projektów topografii układów scalonych o różnej skali integracji wraz z wynikami ich symulacji. Zagadnienia laboratoryjne zostały przedstawione w odniesieniu do całego procesu projektowania układów scalonych w stylu full custom.
The subject of this paper are issues of layout design of CMOS Integrated Circuits. Ali of stages of the full-custom ICs design procedure are described in detail. Capabilities of the Magic layout editor are presented along with same examples of layouts designed with this tool. This paper indicates same experiences gained at the Department of Electronic Circuits where students have a chance to become familiar with the Integrated Circuits design process for a last few years.
Titel: |
Projektowanie topografii cyfrowych i analogowych układów scalonych CMOS z wykorzystaniem pakietu MagicLayout design process of digital and analog CMOS integrated circuits using Magic system
|
---|---|
Autor/in / Beteiligte Person: | Solecki, M. ; Felendzer, Z. |
Link: | |
Medientyp: | serialPeriodical |
Sonstiges: |
|