VLSIレイアウト設計におけるビア数最小位相配線について

藤吉, 邦洋 ; 藤吉邦洋 [著]

1994

Online Hochschulschrift

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Titel:	VLSIレイアウト設計におけるビア数最小位相配線について
Autor/in / Beteiligte Person:	藤吉, 邦洋 ; 藤吉邦洋 [著]
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Veröffentlichung:	1994
Medientyp:	Hochschulschrift
Sonstiges:	Nachgewiesen in: National Diet Library Digital Collections - 国立国会図書館デジタルコレクション Contents Note: 論文目録 / (0002.jp2) -- 目次 / p1 (0004.jp2) -- 第1章序論 / p1 (0006.jp2) -- 1.1 研究の背景と目的 / p1 (0006.jp2) -- 1.2 各章の構成 / p3 (0008.jp2) -- 第2章ビア数最小位相配線問題について / p5 (0010.jp2) -- 2.1 CVM問題 / p5 (0010.jp2) -- 2.2 TVM問題 / p9 (0014.jp2) -- 2.3 ビア数最小位相配線問題の定式化 / p13 (0018.jp2) -- 第3章 2端子ネットビア数最小化問題の区間分割に関する動的計画法による解法 / p17 (0022.jp2) -- 3.1 まえがき / p17 (0022.jp2) -- 3.2 局所ネットに関する最適区間分割 / p18 (0023.jp2) -- 3.3(δ,k,l=0)TVM問題の解法 / p25 (0030.jp2) -- 3.4(δ,k,l)TVM問題への対応 / p33 (0038.jp2) -- 3.5 まとめ / p34 (0039.jp2) -- 第4章多層多端子位相配線におけるネットあたりのビア数について / p36 (0041.jp2) -- 4.1 まえがき / p36 (0041.jp2) -- 4.2 ネット当たりのビア数の上限 / p37 (0042.jp2) -- 4.3 ネットあたりのビア数が上限値と等しくなる問題 / p42 (0047.jp2) -- 4.4 まとめ / p48 (0053.jp2) -- 第5章多端子ネットの2端子ネット集合へのビア数に関する等価変換 / p49 (0054.jp2) -- 5.1 まえがき / p49 (0054.jp2) -- 5.2 位相配線問題TVMの許容解 / p51 (0056.jp2) -- 5.3 ネットの置換可能性 / p54 (0059.jp2) -- 5.4 ビアがTHV型のときの等価変換 / p58 (0063.jp2) -- 5.5 ビアがALV型のときの等価変換 / p65 (0070.jp2) -- 5.6 まとめ / p69 (0074.jp2) -- 第6章結論 / p70 (0075.jp2) -- 参考文献 / p73 (0078.jp2) Document Type: 博士論文 Rights: 国立国会図書館/図書館・個人送信限定 Notes: 博士論文

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