使用90nm CMOS製程設計一轉換增益24.6±1.5 dB、雜訊指數5.6±0.8 dB及34.4mW之 58~66GHz接收機前端電路器

王建今 ; 林佑昇 ; et al.

In: 奈米通訊 / NDL Communications, Jg. 22:3 (2015-09-01), S. 25-30

academicJournal

Titel:	使用90nm CMOS製程設計一轉換增益24.6±1.5 dB、雜訊指數5.6±0.8 dB及34.4mW之 58~66GHz接收機前端電路器
Autor/in / Beteiligte Person:	王建今 ; 林佑昇 ; 李仁豪
Link:	http://www.hyread.com.tw/hypage.cgi?HYPAGE=search/search_detail_new.hpg&dtd_id=3&sysid=00393570
Zeitschrift:	奈米通訊 / NDL Communications, Jg. 22:3 (2015-09-01), S. 25-30
Veröffentlichung:	2015
Medientyp:	academicJournal
Sonstiges:	Nachgewiesen in: HyRead Journal Sprachen: Chinese Alternate Title: A 34.4 mW 58~66 GHz Receiver Front-End with 24.6±1.5 dB Conversion Gain and 5.6±0.8 dB Noise Figure in 90 nm CMO

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使用90nm CMOS製程設計一 轉換增益24.6±1.5 dB、雜訊 指數5.6±0.8 dB及34.4mW之 58~66GHz接收機前端電路器

使用90nm CMOS製程設計一轉換增益24.6±1.5 dB、雜訊指數5.6±0.8 dB及34.4mW之 58~66GHz接收機前端電路器