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Technique for Designing High Speed Noise Immune CMOS Domino High Fan-in Circuits

Lakshmi, A. Chaitanya ; Nausheen, Saba ; et al.
In: International Journal of Engineering and Management Research (IJEMR), Jg. 7 (2017-09-10), Heft 5, S. 178-190
academicJournal

Titel:
Technique for Designing High Speed Noise Immune CMOS Domino High Fan-in Circuits
Autor/in / Beteiligte Person: Lakshmi, A. Chaitanya ; Nausheen, Saba ; Renuka, M.
Zeitschrift: International Journal of Engineering and Management Research (IJEMR), Jg. 7 (2017-09-10), Heft 5, S. 178-190
Veröffentlichung: 2017
Medientyp: academicJournal
ISSN: 2394-6962 (print) ; 2250-0758 (print)
Sonstiges:
  • Nachgewiesen in: IndianJournals.com

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